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1 .
A New Era of Tailored Computing
저자
by
Stephen V. Kosonocky
;
Mark Papermaster
;
Gabriel H. Loh
;
Samuel D. Naffziger
.
소스
VLSI Circuits
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RefWorks
6 .
Zen: An Energy-Efficient High-Performance $\times $ 86 Core
저자
by
Deepesh John
;
Amy Novak
;
Miguel Rodriguez
;
Alex Schaefer
;
Russell Schreiber
, et al.
소스
IEEE Journal of Solid-State Circuits
. 53:102-114
Full Text (IEEE)
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RefWorks
7 .
Steamroller Module and Adaptive Clocking System in 28 nm CMOS
저자
by
Robert S. Orefice
;
Kevin Gillespie
;
Harry R. Fair
;
Stephen V. Kosonocky
;
Donald A. Priore
, et al.
소스
IEEE Journal of Solid-State Circuits
. 50:24-34
Full Text (IEEE)
Web of Science
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RefWorks
7 .
Highlights of the IEEE ISSCC 2014 Processors, Digital, Memory, Biomedical & Next-Generation Systems Technologies, and Imagers, MEMS, Medical & Displays Sessions
저자
by
Stephen V. Kosonocky
;
Yogesh Ramadass
;
Vivek De
;
David Stoppa
;
Jonathan Chang
.
소스
IEEE Journal of Solid-State Circuits
. 50:4-9
Full Text (IEEE)
Web of Science
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RefWorks
7 .
3.2 Zen: A next-generation high-performance ×86 core
저자
by
Joshua A. Bell
;
Teja Singh
;
Stephen V. Kosonocky
;
Sundar Rangarajan
;
Shane Southard
, et al.
소스
ISSCC
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RefWorks
7 .
Modeling and implementation of a fully-digital integrated per-core voltage regulation system in a 28nm high performance 64-bit processor
저자
by
Miguel Rodriguez
;
Milos Trajkovic
;
Ravinder Rachala
;
Stephen V. Kosonocky
.
소스
ISLPED
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RefWorks
6 .
4.2 Increasing the performance of a 28nm x86-64 microprocessor through system power management
저자
by
Adam Clark
;
Aaron Grenat
;
Stephen V. Kosonocky
;
Sriram Sundaram
;
Tom Burd
, et al.
소스
ISSCC
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RefWorks
7 .
Adaptive Voltage Frequency Scaling Using Critical Path Accumulator Implemented in 28nm CPU
저자
by
Sriram Sundaram
;
Sriram Samabmurthy
;
Aaron Grenat
;
Samuel D. Naffziger
;
Michael J. Austin
, et al.
소스
VLSI Design
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RefWorks
7 .
An x86-64 Core in 32 nm SOI CMOS
저자
by
Stephen V. Kosonocky
;
Sriram Sundaram
;
Victor F. Andrade
;
Amy Novak
;
Ravi Jotwani
, et al.
소스
IEEE Journal of Solid-State Circuits
. 46:162-172
Full Text (IEEE)
Web of Science
Scopus
JCR 저널정보
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RefWorks
7 .
A Sub-600-mV, Fluctuation Tolerant 65-nm CMOS SRAM Array With Dynamic Cell Biasing
저자
by
Steven P. Kowalczyk
;
Matthew M. Ziegler
;
Stephen V. Kosonocky
;
Carl J. Radens
;
Kevin Stawiasz
, et al.
소스
IEEE Journal of Solid-State Circuits
. 43:946-955
Full Text (IEEE)
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